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      標簽　>　fpga

      fpga

      fpga

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      FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎上進一步發(fā)展的產(chǎn)物。它是作為專用集成電路（ASIC）領域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點。

      文章：12490個 瀏覽：613178次 帖子：7848個

      fpga技術

      大唐電信FPGA/CPLD數(shù)字電路設計經(jīng)驗分享（3）

      大唐電信FPGA/CPLD數(shù)字電路設計經(jīng)驗分享（3）

      注意：當使用多級非門的時候綜合器往往會將其優(yōu)化掉，因為綜合器會認為一個信號非兩次還是它自己。 需要說明的是在FPGA/CPLD內(nèi)部結(jié)構(gòu)是一種標準的宏單元...

      2017-02-11 標簽：FPGACPLD數(shù)字電路 1319 1

      大唐電信FPGA/CPLD數(shù)字電路設計經(jīng)驗分享（2）

      大唐電信FPGA/CPLD數(shù)字電路設計經(jīng)驗分享（2）

      異步設計不是總能滿足(它們所饋送的觸發(fā)器的)建立和保持時間的要求。因此，異步輸入常常會把錯誤的數(shù)據(jù)鎖存到觸發(fā)器，或者使觸發(fā)器進入亞穩(wěn)定的狀態(tài),在該狀態(tài)下...

      2017-02-11 標簽：FPGACPLD數(shù)字電路 974 0

      大唐電信FPGA/CPLD數(shù)字電路設計經(jīng)驗分享（1）

      大唐電信FPGA/CPLD數(shù)字電路設計經(jīng)驗分享（1）

      在數(shù)字電路的設計中，時序設計是一個系統(tǒng)性能的主要標志，在高層次設計方法中，對時序控制的抽象度也相應提高，因此在設計中較難把握，但在理解RTL電路時序模型...

      2017-02-11 標簽：FPGACPLD數(shù)字電路 1548 0

      如何成長為合格的FPGA開發(fā)者

      論壇中很多朋友是剛剛進入EDA設計領域的，自從進入這個論壇以來，很多朋友談了自己的期望和困惑，下面我僅僅談一些我個人的想法，希望對您有一點幫助。也歡迎更...

      2017-02-11 標簽：FPGAEDA 643 0

      一個牛人對FPGA的理解－－太可怕了！

      FPGA多數(shù)情況下相比ASIC而言，芯片成本大概是100倍的關系，最大的浪費在LUT這里，做出一個LUT-4需要16位存儲單元，再加一個4－16譯碼器，...

      2017-02-11 標簽：FPGA 6.1萬 0

      賽靈思FPGA中LVDS差分高速傳輸?shù)膶崿F(xiàn)

      低壓差分傳送技術是基于低壓差分信號(Low Volt-agc Differential signaling)的傳送技術，從一個電路板系統(tǒng)內(nèi)的高速信號傳送...

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      新手如何學習FPGA外圍硬件電路設計

      在論壇里有人發(fā)帖子，問關于FPGA的硬件電路問題，我想涉及到這個問題的基本都是硬件工程師或者在讀學生，所以我介紹一下我是怎么學習FPGA的硬件電路設計的吧！

      2017-02-11 標簽：FPGAXilinx 2.9萬 0

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      我這個題目想說明的是，F(xiàn)PGA的內(nèi)部的有其相應的Fabric，如何在開發(fā)過程中最好最大限度的使用它。

      2017-02-11 標簽：FPGASTARTUPSRL16 1340 0

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      FPGA器件選型的7個原則：器件供貨渠道和開發(fā)工具的支持、器件的硬件資源、器件的電氣接口標準、器件的速度等級、器件的穩(wěn)定等級、器件的封裝和器件的價格。

      2017-02-11 標簽：FPGA 1563 0

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      然后調(diào)用sinplify，對其進行綜合，結(jié)果很不順利。首先是synplify報不支持器件，才發(fā)現(xiàn)synplify 9.6.2是2008年的產(chǎn)品，比Spa...

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      2017-02-11 標簽：FPGA 5325 0

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      首先要將安裝的ModelSim目錄下的ModelSim.ini屬性設置為存檔類型（去掉只讀）

      2017-02-11 標簽：FPGA 961 0

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      Xilinx FPGA開發(fā)軟件為ISE.現(xiàn)在其版本更新比較快，大家現(xiàn)在常用的版本都在ISE12.1了。

      2017-02-11 標簽：FPGA賽靈思Xilinx 1570 0

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      FPGA基礎知識問答500問連載 （三）

      cmos的高低電平分別為:Vih>=0.7VDD,Vil<=0.3VDD;Voh>=0.9VDD,Vol<=0.1VDD.

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      2017-02-11 標簽：FPGA軟件無線電 868 0

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