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First Input First Output的縮寫，先入先出隊(duì)列，這是一種傳統(tǒng)的按序執(zhí)行方法，先進(jìn)入的指令先完成并引退，跟著才執(zhí)行第二條指令。

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探究USB接口的VSAT基帶數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)

針對衛(wèi)星接收設(shè)備數(shù)據(jù)采集的實(shí)際需要，提出一種基于USB接口的VSAT（甚小口徑衛(wèi)星終端）基帶數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)方

2021-04-08 標(biāo)簽：芯片 cpld USB接口 2641 0

Verilog HDL-同步技術(shù)你了解多少

同步技術(shù) 在芯片設(shè)計(jì)中，數(shù)據(jù)同步和在不同時(shí)鐘域之間進(jìn)行數(shù)據(jù)傳輸會經(jīng)常出現(xiàn)。為避免任何差錯(cuò)、系統(tǒng)故障和數(shù)據(jù)破壞，正確的同步和數(shù)據(jù)傳輸就顯得格外重要。這些問...

2021-09-18 標(biāo)簽：usb fifo Verilog 2487 0

異步FIFO和PLL在高速雷達(dá)數(shù)據(jù)采集系統(tǒng)中的應(yīng)用

異步FIFO和PLL在高速雷達(dá)數(shù)據(jù)采集系統(tǒng)中的應(yīng)用 1 引言隨著雷達(dá)系統(tǒng)中數(shù)字處理技術(shù)的飛速發(fā)展，需要對雷達(dá)回波...

2009-12-22 標(biāo)簽：FIFO PLL 2416 0

SF-EP1C開發(fā)板之基于FIFO的串口發(fā)送機(jī)設(shè)計(jì)

該實(shí)驗(yàn)主要實(shí)現(xiàn)一個(gè)串口發(fā)送器功能，該發(fā)送器的數(shù)據(jù)是從FIF0中讀取的。也就是說，只要FIF0中有數(shù)據(jù)，串口發(fā)送器就會啟動(dòng)，將數(shù)據(jù)發(fā)送出去。

2019-03-07 標(biāo)簽：FIFO 發(fā)送機(jī) 2402 0

FIFO最小深度計(jì)算所有情況

由于平時(shí)我們工作中，F(xiàn)IFO都是直接調(diào)用IP核，對于FIFO深度選擇并沒有很在意，而在筆試面試過程中，經(jīng)常被問及的問題之一就是如何計(jì)算FIFO深度。當(dāng)...

2021-05-11 標(biāo)簽：fifo 2335 0

同步FIFO之Verilog實(shí)現(xiàn)

FIFO的分類根均FIFO工作的時(shí)鐘域，可以將FIFO分為同步FIFO和異步FIFO。同步FIFO是指讀時(shí)鐘和寫時(shí)鐘為同一個(gè)時(shí)鐘。在時(shí)鐘沿來臨時(shí)同時(shí)發(fā)生...

2022-11-01 標(biāo)簽：fifo Verilog 緩存器 2285 0

基于FPGA的FIFO設(shè)計(jì)和應(yīng)用

基于FPGA的FIFO設(shè)計(jì)和應(yīng)用引言　　在利用DSP實(shí)現(xiàn)視頻實(shí)時(shí)跟蹤時(shí)，需要進(jìn)行大量高速的圖像采集。而DSP本身自帶的FIFO并不足以支持系...

2009-11-20 標(biāo)簽：FPGA FIFO 2275 0

你們知道FIFO最小深度計(jì)算嗎

FIFO 最小深度計(jì)算例子 - 1：f_wr 》 f_rd，連續(xù)讀寫寫時(shí)鐘80MHz。讀時(shí)鐘50MHz。 Burst_Len = 120，也就是要...

2021-09-10 標(biāo)簽：數(shù)據(jù)fifo 計(jì)算 2237 0

基于FPGA的IPV6數(shù)字包的分離與封裝的實(shí)現(xiàn)

本文介紹了一種運(yùn)用FPGA將IPV數(shù)據(jù)包的包頭和數(shù)據(jù)部分分離并重新封裝的方法。利用該方法，可以使IPV6數(shù)據(jù)包的拆裝處理速度達(dá)到2Gbit/s以上。

2012-05-21 標(biāo)簽：FIFO FPGA芯片 IPV6數(shù)據(jù)包 2169 0

淺談一種用于MEMS姿態(tài)檢測的FIFO設(shè)計(jì)

通過在MEMS信號處理電路中設(shè)計(jì)一個(gè)異步結(jié)構(gòu)的FIFO，可以有效地降低系統(tǒng)對MEMS的頻繁訪問。設(shè)計(jì)一個(gè)具有多種工作模

2021-04-15 標(biāo)簽：mems RAM fifo 2068 0

大規(guī)模ASIC或FPGA設(shè)計(jì)中異步FIFO設(shè)計(jì)闡述

一、概述在大規(guī)模ASIC或FPGA設(shè)計(jì)中，多時(shí)鐘系統(tǒng)往往是不可避免的，這樣就產(chǎn)生了不同時(shí)鐘域數(shù)據(jù)傳輸?shù)膯栴}，其中一個(gè)比較好的解決方案就是使用異步FIF...

2021-09-30 標(biāo)簽：fpga asic fifo 2063 0

同步FIFO和異步FIFO的區(qū)別同步FIFO和異步FIFO各在什么情況下應(yīng)用

同步FIFO和異步FIFO的區(qū)別同步FIFO和異步FIFO各在什么情況下應(yīng)用？ 1. 同步FIFO和異步FIFO的區(qū)別同步FIFO和異步FIFO在處...

2023-10-18 標(biāo)簽：fifo 2047 0

淺析高速數(shù)模轉(zhuǎn)換器的數(shù)字特性

Other Parts Discussed in Post: DAC34H84作者：Robert Keller，德州儀器 ? 當(dāng)今的高速數(shù)模轉(zhuǎn)換器 ...

2021-11-21 標(biāo)簽：轉(zhuǎn)換器濾波器 fifo 1984 0

FTDI推出一對硬件模塊有利高性能多媒體相關(guān)應(yīng)用

為了補(bǔ)充現(xiàn)已全面生產(chǎn)的FT602 USB 3.1（Gen 1）視頻類FIFO芯片，同時(shí)FTDI也推出此系列的一對硬件模塊。 UMFT602A和UMFT6...

2018-05-03 標(biāo)簽：連接器 fifo ftdi 1704 0

MAX3108帶有FIFO的SPI UART

小尺寸的MAX3108通用異步收發(fā)器與128字的接收和發(fā)送FIFO每個(gè)(UART)是控制通過串行I ² C或SPI™控制器接口。

2011-02-22 標(biāo)簽：FIFO SPI UART 1603 0

貿(mào)澤備貨Bosch BMP388數(shù)字氣壓傳感器，適用于無人機(jī)等應(yīng)用

貿(mào)澤備貨的Bosch BMP388數(shù)字氣壓傳感器采用經(jīng)驗(yàn)證的傳感原理來測量壓力和溫度。此24位器件能夠測量300 hPa至1250 hPa的氣壓，在1 ...

2018-07-12 標(biāo)簽：fifo 壓力傳感器 bosch 1578 0

雙塔模型擴(kuò)量負(fù)樣本的方法比較

雙塔模型在訓(xùn)練時(shí)是對一個(gè)batch內(nèi)樣本訓(xùn)練。一個(gè)batch內(nèi)每個(gè)樣本 (user和item對)為正樣本，該user與batch內(nèi)其它item為負(fù)樣本。...

2022-07-08 標(biāo)簽：神經(jīng)網(wǎng)絡(luò)fifo 1511 0

基于異步FIFO和鎖相環(huán)(PLL)的雷達(dá)數(shù)據(jù)采集系統(tǒng)

　　1 引言　　隨著雷達(dá)系統(tǒng)中數(shù)字處理技術(shù)的飛速發(fā)展，需要對雷達(dá)回波信號進(jìn)行高速數(shù)據(jù)采集。在嵌入式條件下，要求獲取數(shù)據(jù)的速度越來越快。精度越來越高，以致數(shù)

2010-08-19 標(biāo)簽：鎖相環(huán)FIFO 1378 0

fpga跨時(shí)鐘域通信時(shí)，慢時(shí)鐘如何讀取快時(shí)鐘發(fā)送過來的數(shù)據(jù)？

fpga跨時(shí)鐘域通信時(shí)，慢時(shí)鐘如何讀取快時(shí)鐘發(fā)送過來的數(shù)據(jù)？在FPGA設(shè)計(jì)中，通常需要跨時(shí)鐘域進(jìn)行數(shù)據(jù)通信。跨時(shí)鐘域通信就是在不同的時(shí)鐘域之間傳輸數(shù)據(jù)...

2023-10-18 標(biāo)簽：FPGA設(shè)計(jì)fifo 緩存器 1363 0

嵌入式 FIFO 數(shù)據(jù)傳輸系統(tǒng)設(shè)計(jì)

本文以dMAX和EMIF接口的數(shù)據(jù)傳輸為例，介紹嵌入式FIFO的設(shè)計(jì)、配置及其使用。

2011-06-23 標(biāo)簽：嵌入式數(shù)據(jù)傳輸 FIFO 1294 0

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Protues

Protues

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Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件（該軟件中國總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

Altium Designer

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FPGA芯片

FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
AD10

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識別

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FPGA開發(fā)板

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FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過去汽車電子產(chǎn)品的開發(fā)周期是漫長的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長寬，直插，貼片，焊盤的大小，管腳的長寬，管腳的間距等）用圖形方式表現(xiàn)出來，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
語音交互

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PCB封裝庫

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AD09

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PDN

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QuickPcb

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Artix-7

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　　Artix-7 系列：相對于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對的市場領(lǐng)域。
VHDL代碼

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Protel 99 se

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powerlink

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candence

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面包板

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面包板是由于板子上有很多小插孔，專為電子電路的無焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
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時(shí)鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號，也可以是壓力、溫度、濕度、位移、聲音等非電信號；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號的變化量。
驅(qū)動(dòng)電流

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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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FPGA教程

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紅外觸摸屏

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