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      標(biāo)簽　>　邏輯電平

      邏輯電平

      +關(guān)注0人關(guān)注

      邏輯電平是指一種可以產(chǎn)生信號的狀態(tài)，通常由信號與地線之間的電位差來體現(xiàn)。邏輯電平的浮動范圍由邏輯家族中不同器件的特性所決定。

      文章：99個(gè) 瀏覽：14739次 帖子：12個(gè)

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      2017-12-01 標(biāo)簽：邏輯電平 9181 0

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      cmos的高低電平分別為:Vih>=0.7VDD,Vil<=0.3VDD;Voh>=0.9VDD,Vol<=0.1VDD.

      2017-02-11 標(biāo)簽：FPGA邏輯電平 952 0

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