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可編程邏輯

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邏輯器件可分為兩大類 – 固定邏輯器件和可編程邏輯器件。正如其命名一樣，固定邏輯器件中的電路是永久性的，它們完成一種或一組功能 —— 一旦制造完成，就無法改變。

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全部技術資訊資料帖子視頻產品方案企業(yè) 可編程邏輯選型

可編程邏輯技術

Xilinx可編程邏輯器件設計與開發(fā)（基礎篇）連載11：Spartan

Spartan-6 CMT是一個靈活、高性能的時鐘管理模塊。它位于芯片中央、垂直的全局時鐘網絡旁。如圖2-17所示，它包含一個PLL和兩個DCM。

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 1130 0

Xilinx可編程邏輯器件設計與開發(fā)（基礎篇）連載10：Spartan

Spartan-6的時鐘布線網絡包括由BUFGMUX驅動的全局時鐘網絡和由I/O時鐘緩沖器（BUFIO2）、PLL時鐘緩沖器（BUFPLL）驅動的I/O...

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 879 0

Xilinx可編程邏輯器件設計與開發(fā)（基礎篇）連載9：Spartan

除了全局時鐘緩沖器外，Spartan-6還包含驅動高速I/O時鐘區(qū)域的時鐘緩沖器。

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 1644 0

7 50T 入門級FPGA評估套件上手評測

FPGA即現場可編程門陣列，屬于可編程邏輯器件的一種。隨著工藝的進步和EDA設計工具的不斷發(fā)展，FPGA的門檻（學習成本和價格成本）也越來越低，目前已經...

2017-02-11 標簽：FPGA Xilinx 可編程邏輯 1111 0

Xilinx可編程邏輯器件設計與開發(fā)（基礎篇）連載40：Spartan

最大化【Package Pins】，如圖10-45 所示，和按鈕配合，完成對器件引腳的排序，如圖中我們將所有VREF 引腳排在一起，選中所有VREF ...

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 786 0

Xilinx可編程邏輯器件設計與開發(fā)（基礎篇）連載39：Spartan

下面通過一個簡單的實例介紹如何創(chuàng)建PlanAhead項目，進行I/O規(guī)劃。

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 499 0

Xilinx可編程邏輯器件設計與開發(fā)（基礎篇）連載38：Spartan

PlanAhead允許導入多種不同類型的源文件，包括HDL和NGC核。在RTL編輯器中可以打開、編輯、開發(fā)RTL源文件。下面我們介紹【Sources】源...

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 1251 0

Xilinx可編程邏輯器件設計與開發(fā)（基礎篇）連載37：Spartan

這里介紹如何用PlanAhead進行RTL代碼開發(fā)與分析。需要說明一點，本章所用的所有實例都可以在PlanAhead的安裝目錄E:\Xilinx\11....

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 870 0

Xilinx可編程邏輯器件設計與開發(fā)（基礎篇）連載36：Spartan

PlanAhead工具是Xilinx提供的一個集成的、可視化的FPGA設計工具，它可以被應用于FPGA設計過程中的不同階段，常見的應用包括用PlanAh...

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 2072 0

Xilinx可編程邏輯器件設計與開發(fā)（基礎篇）連載34：Spartan

ChipScope Pro內核插入器的文件后綴名為cdc。在ISE工程中可以創(chuàng)建一個新的cdc程序，也可以在實現流程中激活內核插入器。

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 1162 0

Xilinx可編程邏輯器件設計與開發(fā)（基礎篇）連載35：Spartan

ChipScope Pro 分析工具（Analyzer tool）直接與ICON、ILA、IBA、VIO及IBERT核相連，用戶可以實時地創(chuàng)建或修改觸發(fā)條件。

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 1864 0

Xilinx可編程邏輯器件設計與開發(fā)（基礎篇）連載33：Spartan

下面通過一個簡單8位計數器的例子，了解如何在工程中添加ChipScope Pro內核生成器的各個IP核，對FPGA內部節(jié)點和邏輯進行觀測。在該實例中，我...

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 932 0

Xilinx可編程邏輯器件設計與開發(fā)（基礎篇）連載32：Spartan

雙擊【Xilinx Core Generator】，打開現有的IP核工程項目或者創(chuàng)建一個新的IP核工程。

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 841 0

Xilinx可編程邏輯器件設計與開發(fā)（基礎篇）連載31：Spartan

雙擊【Xilinx Core Generator】，打開現有的IP核工程項目或者創(chuàng)建一個新的IP核工程?！綱iew by function】→【Debu...

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 698 0

Xilinx可編程邏輯器件設計與開發(fā)（基礎篇）連載30：Spartan

Xilinx針對不同類型的調試IP核，提供了不同的核生成器。本節(jié)重點介紹Xilinx Core Generator Tool（Xilinx IP核生成器...

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 974 0

Xilinx可編程邏輯器件設計與開發(fā)（基礎篇）連載29：Spartan

ChipScope Pro 提供了多種不同功能的調試內核，通常分成三類：邏輯調試內核、誤比特率測試核和集成總線分析核。用戶根據系統的調試要求，應用不同的...

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 851 0

Xilinx可編程邏輯器件設計與開發(fā)（基礎篇）連載28：Spartan

FPGA和PCB設計人員保留一定數量FPGA引腳作為測試引腳，FPGA設計者在編寫FPGA代碼時，將需要觀察的FPGA內部信號定義為模塊的輸出，在綜合實...

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 811 0

Xilinx可編程邏輯器件設計與開發(fā)（基礎篇）連載41：Spartan

設計者可以在【Clock Regions】窗口、【I/O Ports】窗口或者【Package Pins】窗口選擇一個或多個對象，或者單擊按鈕取消所有選...

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 674 0

Xilinx可編程邏輯器件設計與開發(fā)（基礎篇）連載45：Spartan

本節(jié)將簡單介紹在PlanAhead工具中如何應用ChipScope核和分析工具進行邏輯調試與驗證。先通過一個向導將ChipScope核插入設計中，選擇待...

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 899 0

Xilinx可編程邏輯器件設計與開發(fā)（基礎篇）連載44：Spartan

FloorPlanning 工具是PlanAhead 的一個組成部分，用它可以對FPGA 設計進行分析，首先找到設計中的時序問題或者擁塞的問題，然后再通...

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 810 0

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