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      電子發燒友網>電子資料下載>電子論文>測試測量論文>“綁定中測試”“多綁一測”對于測試過程的影響

      “綁定中測試”“多綁一測”對于測試過程的影響

      2017-11-27 | rar | 0.61 MB | 次下載 | 2積分

      資料介紹

      　　隨著半導體工藝水平的不斷發展，3D芯片技術已成為一大研究熱點。“綁定中測試”環節的提出對于芯片的測試流程有了新的要求。但是，“綁定中測試”“一綁一測”的特點會使部分裸片被重復測試，從而帶來測試時間的增加。從“綁定中測試”的過程出發，協同考慮測試功耗與“理論制造成本”對于“綁定中測試”的影響，提出“多綁一測”的測試流程。在此基礎上提出相應的廣度優先遍歷算法，結合ITC02電路的相關參數，體現本文思想在實際生產制造中的現實意義。

      “綁定中測試”“多綁一測”對于測試過程的影響

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