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      一種節(jié)省硬件資源的DFT偽碼捕獲實現(xiàn)方法

      2009-09-22 | rar | 240 | 次下載 | 3積分

      資料介紹

      DFT 偽碼捕獲算法在進行偽碼搜索的同時估計多普勒頻偏，為了滿足捕獲精度要求，需
      要增加DFT 點數(shù)，但隨著運算點數(shù)的增加硬件實現(xiàn)難度成倍增長。本文提出一種基于FPGA 的在不增加DFT 點數(shù)的前提下實現(xiàn)高精度偽碼捕獲的方法，詳細介紹了如何通過采用查找表和浮動窗等方法在保證系統(tǒng)性能的同時節(jié)省資源，通過在FPGA 器件中驗證表明該方法捕獲速度快，精度高，硬件實現(xiàn)簡單，占用資源少，有很強的實用價值。
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