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      基于SRAM和DRAM結(jié)構(gòu)的大容量FIFO的設(shè)計(jì)與實(shí)現(xiàn)

      2010-02-06 | rar | 444 | 次下載 | 5積分

      資料介紹

      基于SRAM 和DRAM 結(jié)構(gòu)的大容量FIFO 的設(shè)計(jì)與實(shí)現(xiàn)
      作者：楊奇 楊瑩
      摘要：本文分別針對Hynix 公司的兩款SRAM 和DRAM 器件，介紹了使用CPLD 進(jìn)行接口
      連接和編程控制，來構(gòu)成低成本、大容量、高速度FIFO 的方法。該方法具有通用性，可以方便地移植到與其他RAM 器件相連的應(yīng)用中去。
      關(guān)鍵詞：CPLD，SRAM，DRAM，F(xiàn)IFO
      1 引言
      FIFO(First In First Out)是一種具有先進(jìn)先出存儲(chǔ)功能的部件，在高速數(shù)字系統(tǒng)當(dāng)中通常用作數(shù)據(jù)緩存。在高速數(shù)據(jù)采集、傳輸和實(shí)時(shí)顯示控制領(lǐng)域中，往往需要對大量數(shù)據(jù)進(jìn)行快速存儲(chǔ)和讀取，而這種先進(jìn)先出的結(jié)構(gòu)特點(diǎn)很好地適應(yīng)了這些要求，是傳統(tǒng)RAM 無法達(dá)到的。許多系統(tǒng)都需要大容量FIFO 作為緩存，但是由于成本和容量限制，常采用多個(gè)FIFO 芯片級聯(lián)擴(kuò)展，這往往導(dǎo)致系統(tǒng)結(jié)構(gòu)復(fù)雜，成本高。本文分別針對Hynix 公司的兩款SRAM 和DRAM 器件，介紹了使用CPLD 進(jìn)行接口連接和編程控制，來構(gòu)成低成本、大容量、高速度FIFO 的方法。該方法具有通用性，可以方便地移植到與其他RAM 器件相連的應(yīng)用中去。
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