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簡介：本文以擴(kuò)頻通信和差錯控制碼的設(shè)計(jì)和實(shí)現(xiàn)為核心，對擴(kuò)頻通信的基本理論、差錯控制碼的編碼原理以及偽隨機(jī)碼進(jìn)行了深入的研究和分析，提出來一種基于FPGA的直接序列擴(kuò)頻和差錯控制碼編碼系統(tǒng)的實(shí)現(xiàn)方案，完成了直接序列擴(kuò)頻和差錯控制碼編碼系統(tǒng)的仿真和實(shí)現(xiàn)，同時采用Altera公司的Quartus II軟件，使用verilog語言完成了本設(shè)計(jì)，并進(jìn)行仿真，驗(yàn)證了擴(kuò)頻系統(tǒng)的可行性。
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