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      電子發燒友網>電子資料下載>電子資料>如何優化 PCIe 應用中的時鐘分配

      如何優化 PCIe 應用中的時鐘分配

      2022-11-07 | pdf | 309.03KB | 次下載 | 免費

      資料介紹

      PCI Express? (PCIe?) 是一項業界領先的標準輸入／輸出 (I/O) 技術，是服務器、個人電腦以及其它應用中最常用的 I/O 接口之一。該標準多年來不斷發展，以適應更高的數據速率（見表 1）。第 3 代 PCIe 引入了全新的編碼方案，其可在不增加數據速率一倍的情況下，將數據吞吐量提升一倍。PCI-SIG 近期宣布推出的第 4 代 PCIe 具有 16 G 每秒傳輸 (GT/s) 的比特率。第 4 代的規范預計將在 2014 或 2015 年發布。 表 1：各代 PCIe 的數據吞吐量 隨著數據速率的提升，參考時鐘需求也在不斷提高。本文將重點介紹參考時鐘需求。 PCIe 參考時鐘 (RefClk) 規范可針對 3 種不同架構定義，分別是：數據時鐘、獨立 RefClk 以及通用 RefClk。每個架構都具有特定的濾波器函數。在接收器時鐘數據恢復輸入端出現的有效抖動是接收器及發送器…
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