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本文提出了一種實現信號采集方案，介紹了由ARM 處理器S3C2410 和EP2C8 FPGA 組成的高速信號采集系統的系統設計，并著重介紹前端硬件的設計，并就ARM 處理器和FPGA 的互聯設計進行探討。利用FPGA 硬件控制A/D 轉換，達到了較好的效果，實現了信號的采集與存儲。
在圖像處理，瞬態信號檢測、工業、國防、通信等領域常常需要對傳感器等的外部輸入信號進行處理與存儲。采用ARM 嵌入式處理器與FPGA 的方式來實現高速數據的采集和存儲，提供了一種高速度、高精度、低成本的數據采集方案。本系統使用Samsung公司的S3C2410 處理器和Altera 公司的EP2C8 FPGA作為系統的核心，同時使用Ti 公司的A/D 轉換芯片ADS5220 對輸入信號做模數轉換，可以實現采樣頻率達到1-40MHz。本文從硬件設計角度介紹系統的設計， 著重介紹FPGA 和ARM 處理器的互聯設計。
1 系統結構
系統主要由A/D 轉換器、FPGA 和ARM 處理器三大部分組成。通過AD 芯片以1～40MHz 的采樣率把輸入模擬信號轉換為12bit 精度的數字信號，經過FPGA 中的FIFO 存儲器緩存后由ARM 處理器以DMA的方式接收采集數據，再通過IDE 接口存儲數據到大容量硬盤，ARM 處理器接收數據之前可在FPGA 中以硬件實現數字濾波，處理分析，數據壓縮等硬件單元，或由ARM 處理器做一些簡單的處理。圖1 是系統的結構框圖。
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