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鎖相環（PLL）是集成電路中非常重要的模塊，常常用來實現時鐘倍頻，時
鐘綜合，抖動衰減，數據時鐘恢復等功能。PLL 是一個非線性的離散系統，很難
準確刻畫。在一定的條件下——開環帶寬小于參考頻率的1/10——可以把它作為
一個線性系統來近似處理。在行為級，或稱系統級，工程師可以用一些輔助工具
如Matlab 或Verilog-A，來實現PLL 的模型。在將行為級的模型細化為晶體管級
的電路時，工程師們一般是把PLL 的各個子模塊分別設計和刻畫，再用線性模
型把它們組合在一起，得到各種環路參數。其中的原因有兩個：一是線性模型的
準確性很高，能夠滿足工程的需要；二是整個PLL 一起仿真時，對硬件和軟件
的要求都很高：單單一個瞬態仿真，在滿足精度和功能兩個條件下，就要花費數
小時，甚至數天，更別說要仿真環路參數了。這樣的代價在工程開發中是不可接
受的。
鐘綜合，抖動衰減，數據時鐘恢復等功能。PLL 是一個非線性的離散系統，很難
準確刻畫。在一定的條件下——開環帶寬小于參考頻率的1/10——可以把它作為
一個線性系統來近似處理。在行為級，或稱系統級，工程師可以用一些輔助工具
如Matlab 或Verilog-A，來實現PLL 的模型。在將行為級的模型細化為晶體管級
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