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設(shè)計(jì)好的電路圖通過仿真軟件進(jìn)行實(shí)時(shí)模擬，模擬出實(shí)際功能，然后通過其分析改進(jìn)，從而實(shí)現(xiàn)電路的優(yōu)化設(shè)計(jì)。是EDA(電子設(shè)計(jì)自動(dòng)化)的一部分。
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