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      電子發燒友網>電子資料下載>可編程邏輯>FPGA/ASIC>如何使用FPGA實現高吞吐量低存儲量的LDPC碼譯碼器

      如何使用FPGA實現高吞吐量低存儲量的LDPC碼譯碼器

      2021-02-03 | rar | 0.45 MB | 次下載 | 免費

      資料介紹

      　　針對一類規則（r，c）-LDPC（low-density parity check）碼，提出了一種基于Turbo譯碼算法的高吞吐量存儲器效率譯碼器。與傳統的和積譯碼算法相比，Turbo譯碼算法對多個分組進行并行譯碼，每個分組采用并行結構進行譯碼，具有更快的收斂速度和更少的存儲空間。為了對一個具有并行結構的數據包進行解碼，首先將LDC碼分為若干個超碼。然后用并行BCJR算法對每個超碼進行解碼。為了進一步簡化算法的內部結構和復雜度，提出了一種改進的陪集算法。基于Altera Stratix EP1S25 FPGA器件，開發了一種包含15個并行譯碼器的FPGA芯片，用于長度為1600的規則（r，c）-LDPC碼，可并行解碼3個數據包，通過20次解碼迭代可達到50Mbit/s的吞吐量。

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