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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>使用FPGA實(shí)現(xiàn)模數(shù)轉(zhuǎn)換的源代碼和流程圖詳細(xì)說明

      使用FPGA實(shí)現(xiàn)模數(shù)轉(zhuǎn)換的源代碼和流程圖詳細(xì)說明

      2020-09-07 | rar | 0.08 MB | 次下載 | 免費(fèi)

      資料介紹

      　　以下是ADC0809 采樣一次模擬信號(hào)的流程圖，在源程序中是不斷循環(huán)不斷采樣的。首先對(duì)ADC0809 初始化，即對(duì)各個(gè)控制信號(hào)線復(fù)位，包括地址鎖存信號(hào)ALE ，啟動(dòng)采樣信號(hào)START，輸出數(shù)據(jù)有效OE 和數(shù)據(jù)鎖入LOCK。隨后就是啟動(dòng)AD 轉(zhuǎn)換，期間一直檢測(cè)EOC（轉(zhuǎn)換完成）是否由低電平變?yōu)楦唠娖健Ｈ鬍OC 由低電平變?yōu)楦唠娖絼t說明AD 轉(zhuǎn)換結(jié)束，于是將OE（輸出數(shù)據(jù)有效）置為高電平，表明AD 的數(shù)據(jù)總線D［7..0］ 已從原來的高阻態(tài)變?yōu)檩敵鰯?shù)據(jù)有效。最后開啟數(shù)據(jù)鎖存信號(hào)LOCK 將數(shù)據(jù)鎖入寄存器。

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