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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>FPGA個人學(xué)習(xí)總結(jié)

      FPGA個人學(xué)習(xí)總結(jié)

      2012-05-22 | rar | 569KB | 次下載 | 免費

      資料介紹

      　　1. 綜合方面

      　　1) 經(jīng)綜合后：

      　　普通的數(shù)據(jù)單端輸入都會加一個IBUF緩沖器;

      　　數(shù)據(jù)單端輸出有個OBUF緩存器;

      　　時鐘輸入口會加BUFGP緩沖器;

      　　對于4選1的mux，if結(jié)構(gòu)和case結(jié)構(gòu)都只需要一個slice，由MUXF5控制兩個LUT....

      　　2.LUT的名字后_數(shù)字，那個數(shù)字代表什么意思?

      　　LUTa_b：a代表所有輸入數(shù)據(jù)位寬，即輸入數(shù)據(jù)的個數(shù)，切勿將位寬理解為“每個輸入端口的數(shù)據(jù)寬度(因每個輸入端口是單bit輸入);b代表LUT被初始化的狀態(tài)

      　　3.比較器位寬大小對綜合結(jié)構(gòu)的影響

      　　當(dāng)比較的位寬高于一定位數(shù)時，綜合會采用進(jìn)位鏈結(jié)構(gòu)，如下圖：

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