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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>密勒調(diào)制副載波編解碼器的FPGA實(shí)現(xiàn)

      密勒調(diào)制副載波編解碼器的FPGA實(shí)現(xiàn)

      2011-08-15 | pdf | 498 KB | 次下載 | 免費(fèi)

      資料介紹

      在研究密勒調(diào)制副載波序列特點(diǎn)的基礎(chǔ)上，提出一種基于FPGA并運(yùn)用VerilogHDL硬件描述語(yǔ)言實(shí)現(xiàn)的密勒調(diào)制副載波編解碼設(shè)計(jì)方法，并利用Altera公司CycloneI系列EP1C12Q芯片與Verilog HDL硬件描述語(yǔ)言實(shí)現(xiàn)。仿真結(jié)果表明，采用FPGA完成密勒調(diào)制副載波編解碼設(shè)計(jì)，編解碼模塊輸出完全正確，處理速度快，達(dá)到了設(shè)計(jì)預(yù)期要求，編解碼設(shè)計(jì)具有效率高、擴(kuò)展性強(qiáng)、方便集成等優(yōu)點(diǎn)。

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