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一 實(shí)驗(yàn)?zāi)康?/B>
熟悉利用Quartus II 的原理圖輸入方法設(shè)計(jì)簡單組合電路，掌握層次化設(shè)計(jì)的方法，并通過一個(gè)8位全加器的設(shè)計(jì)把握利用EDA軟件進(jìn)行原理圖輸入方式的電子線路設(shè)計(jì)的詳細(xì)流程。
二 實(shí)驗(yàn)原理
一個(gè)8位全加器可以由8個(gè)一位全加器構(gòu)成，加法器間的進(jìn)位可以串行方式實(shí)現(xiàn)，即將低位加法器的進(jìn)位輸出 cout 與相鄰的高位加法器的最低進(jìn)位輸入信號(hào) cin 相接。而1位全加器可以按照5.4節(jié)介紹的方法來完成。
?
三 實(shí)驗(yàn)內(nèi)容
1：完成半加器和全加器的設(shè)計(jì)，包括原理圖輸入、編譯、綜合、適配、仿真、實(shí)驗(yàn)板上的硬件測試，并將此全加器電路設(shè)計(jì)成一個(gè)硬件符號(hào)入庫。鍵1、鍵2、鍵3（PIO
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