FPGA設計高級技巧(Xilinx篇）

隨著HDL （Hardware Description Language，硬件描述語言）語言、綜合工具及其它相關工具的推廣，使廣大設計工程師從以往煩瑣的畫原理圖、連線等工作解脫開來，能夠將工作重心轉移到功能實現(xiàn)上，極大地提高了工作效率。

任何事務都是一分為二的，有利就有弊。我們發(fā)現(xiàn)，現(xiàn)在越來越多的工程師不關心自己的電路實現(xiàn)形式，以為“我只要將功能描述正確，其它事情交給工具就行了”。在這種思想影響下，工程師在用HDL語言描述電路時，腦袋里沒有任何電路概念，或者非常模糊;也不清楚自己寫的代碼綜合出來之后是什么樣子，映射到芯片中又會是什么樣子，有沒有充分利用到FPGA的一些特殊資源。

遇到問題，立刻想到的是換速度更快、容量更大的FPGA器件，導致物料成本上升：更為要命的是，由于不了解器件結構，更不了解與器件結構緊密相關的設計技巧，過分依賴綜合等工具，工具不行，自己也就東手無策，導致問題遲遲不能解決，從而嚴重影響開發(fā)周期，導致開發(fā)成本急劇上升。

編輯：黃飛

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