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SystemVerilog中的fork-join_any

芯片驗(yàn)證工程師 ? 來(lái)源:芯片驗(yàn)證工程師 ? 作者:芯片驗(yàn)證工程師 ? 2022-12-09 09:05 ? 次閱讀

fork-join_any和fork-join有所不同,fork-join_any的父進(jìn)程一直阻塞,直到任何一個(gè)并行的子進(jìn)程結(jié)束。

需要注意的是,當(dāng)其中任何一個(gè)子進(jìn)程和父進(jìn)程結(jié)束后,剩余未結(jié)束的子進(jìn)程不會(huì)停止,而是會(huì)一直執(zhí)行下去,直到仿真停止。

 module forkJoin;
 int a, b, c, d;
 initial
 begin
 fork : forkBlock
 
 begin //frst process
 #50 a = 5;
 $display($stime,,,"a = %0d",a);
 end
 
 begin //second process
 #100 b = 10;
 $display($stime,,,"b = %0d",b);
 end
 
 begin //third process
 #100 c = 20;
 $display($stime,,,"c = %0d",c);
 end
 
 begin //fourth process
 #40 d = 15;
 $display($stime,,,"d = %0d",d);
 end
 
 join_any
 
 $display($stime,,, "out of the loop");


 end
 endmodule

仿真log:

 40 d = 15
 40 out of the loop


 V C S S i m u l a t i o n R e p o r t

上面的fork-join-any示例中有4個(gè)子進(jìn)程,分別在時(shí)間40,50,100,100執(zhí)行。隨著進(jìn)程4結(jié)束,父進(jìn)程也會(huì)結(jié)束,仿真隨之停止。

審核編輯:湯梓紅

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原文標(biāo)題:SystemVerilog中的fork-join_any

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