一種基于矩陣的并行CRC校驗(yàn)算法
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針對(duì)高速網(wǎng)絡(luò)通信中高位寬并行數(shù)據(jù)的實(shí)時(shí)校驗(yàn)需求，提出了一種可單周期實(shí)現(xiàn)的、面向128位并行數(shù)據(jù)的循環(huán)冗余校驗(yàn)算法（Cyclic Redundancy Check，CRC ）。該算法首先根據(jù)CRC 串行編碼原理得到8 位并行數(shù)據(jù)的CRC 校驗(yàn)矩陣，之后對(duì)矩陣進(jìn)行迭代簡化，得到32 位并行數(shù)據(jù)的參數(shù)矩陣，此參數(shù)矩陣作為該CRC 算法的核心實(shí)現(xiàn)了對(duì)數(shù)據(jù)進(jìn)行預(yù)處理。最后對(duì)該算法進(jìn)行了硬件實(shí)現(xiàn)，仿真及綜合結(jié)果表明，該算法可在單周期內(nèi)完成對(duì)128 位并行數(shù)據(jù)的CRC 編碼和解碼校驗(yàn)，時(shí)鐘頻率提高1.8 倍，而硬件開銷僅增加5.15%。
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