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FPGA(Field-Programmable Gate Array),即現(xiàn)場(chǎng)可編程門(mén)陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專(zhuān)用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門(mén)電路數(shù)有限的缺點(diǎn)。
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為了提高傳輸速率,擴(kuò)大通信容量,減少信道數(shù)量,通常把多路信號(hào)復(fù)用成一路信號(hào)進(jìn)行傳輸。在多種復(fù)用方式中,時(shí)分復(fù)用是一種常用的方式。時(shí)分復(fù)用是多路信號(hào)按照時(shí)...
FPGA云端技術(shù)提供商創(chuàng)業(yè)的商業(yè)分析
2016年底,亞馬遜網(wǎng)絡(luò)服務(wù)宣布將通過(guò)云交付模式提供高端XilinxFPGA服務(wù),同時(shí),國(guó)內(nèi)云服務(wù)商騰訊云也宣布推出FPGA云服務(wù)器,使FPGA為數(shù)據(jù)中...
2018-06-30 標(biāo)簽:fpga 1872 0
采用FPGA器件實(shí)現(xiàn)GPS數(shù)據(jù)加密系統(tǒng)中機(jī)載模塊中DES IP的設(shè)計(jì)
針對(duì)GPS測(cè)量系統(tǒng)數(shù)據(jù)傳輸過(guò)程中的安全問(wèn)題,采用FPGA技術(shù)設(shè)計(jì)了GPS數(shù)據(jù)加密系統(tǒng)。系統(tǒng)移植MD5算法到NIOS中對(duì)系統(tǒng)口令加密,并設(shè)計(jì)DES IP對(duì)...
正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻:PIO IRQ
該課程是正點(diǎn)原子團(tuán)隊(duì)編寫(xiě),詳細(xì)講解了quartus中的qsys。也可以從我頭像點(diǎn)進(jìn)去看FPGA verilog相關(guān)的視頻。
基于DSP+FPGA的紅外移動(dòng)目標(biāo)識(shí)別跟蹤系統(tǒng)設(shè)計(jì)
與通用集成電路相比,ASIC芯片具有體積小、重量輕、功耗低、可靠性高等幾個(gè)方面的優(yōu)勢(shì),而且在大批量應(yīng)用時(shí),可降低成本。##在本系統(tǒng)中,F(xiàn)PGA控制了絕大...
FPGA視頻教程:SF-EP1C開(kāi)發(fā)板-基于FIFO的串口發(fā)送機(jī)設(shè)計(jì)
發(fā)送機(jī)是指產(chǎn)生并送出信號(hào)或數(shù)據(jù)的設(shè)備。光發(fā)送機(jī)是光傳輸網(wǎng)中的一類(lèi)設(shè)備,和光接收機(jī)成對(duì)使用。光發(fā)送機(jī)將電信號(hào)轉(zhuǎn)成光信號(hào),通過(guò)光纖發(fā)送,光接收機(jī)則將光信號(hào)轉(zhuǎn)...
數(shù)字設(shè)計(jì)FPGA應(yīng)用:按鍵掃描設(shè)計(jì)
本課程以目前流行的Xilinx 7系列FPGA的開(kāi)發(fā)為主線,全面講解FPGA的原理及電路設(shè)計(jì)、Verilog HDL語(yǔ)言及VIVADO的應(yīng)用,并循序漸進(jìn)...
2019-12-05 標(biāo)簽:fpga設(shè)計(jì)按鍵 1868 0
基于FPGA的數(shù)字電壓表(AD)設(shè)計(jì)
TLC549是一個(gè)8位的串行模數(shù)轉(zhuǎn)換器,A/D轉(zhuǎn)換時(shí)間最大為17us,最大轉(zhuǎn)換速率為4MHz。下圖為T(mén)LC549的訪問(wèn)時(shí)序,從圖中可以看出,TLC549...
2024-04-22 標(biāo)簽:FPGA轉(zhuǎn)換器電壓表 1868 0
蔚來(lái)汽車(chē)自主開(kāi)發(fā)的激光雷達(dá)的芯片設(shè)計(jì)分析
FPGA 在激光雷達(dá)中充當(dāng)主控芯片,進(jìn)行信號(hào)處理、電機(jī)時(shí)序控制等,CPU 雖然也能做。這一次的改進(jìn),采用專(zhuān)用的算法 以及為算法專(zhuān)門(mén)優(yōu)化設(shè)計(jì)的電路。
FPGA之流水線練習(xí)(2):設(shè)計(jì)思路
流水線安裝時(shí)工作地的排列要符合工藝路線,當(dāng)工序具有兩個(gè)以上工作地時(shí),要考慮同一工序工作地的排列方法。一般當(dāng)有兩個(gè)或兩個(gè)以上偶數(shù)個(gè)同類(lèi)工作地時(shí),要考慮采用...
Xilinx的新一代設(shè)計(jì)套件Vivado相比上一代產(chǎn)品 ISE,在運(yùn)行速度、算法優(yōu)化和功能整合等很多方面都有了顯著地改進(jìn)。但是對(duì)初學(xué)者來(lái)說(shuō),新的約束語(yǔ)言...
FPGA之FIFO練習(xí)1:設(shè)計(jì)思路
FIFO隊(duì)列具有處理簡(jiǎn)單,開(kāi)銷(xiāo)小的優(yōu)點(diǎn)。但FIFO不區(qū)分報(bào)文類(lèi)型,采用盡力而為的轉(zhuǎn)發(fā)模式,使對(duì)時(shí)間敏感的實(shí)時(shí)應(yīng)用(如VoIP)的延遲得不到保證,關(guān)鍵業(yè)務(wù)...
Virtex-7 FPGA Gen3 Integrated Block 的 TAG 管理
在 PCIE 系統(tǒng)里面,TAG 管理是一個(gè)重要的問(wèn)題。用戶邏輯依賴于 TAG 來(lái)定位 completion對(duì)應(yīng)于哪個(gè) Non-Posted 事務(wù)。所以,...
2017-11-18 標(biāo)簽:fpga 1859 0
關(guān)于FPGA 脈動(dòng)陣列的設(shè)計(jì)方案解析
脈動(dòng)陣列:數(shù)據(jù)流同步流過(guò)相鄰的二維陣列單元的處理器結(jié)構(gòu),一般不同方向流過(guò)不同數(shù)據(jù)。
基于FPGA和EPlK30TCl44-3d實(shí)現(xiàn)超聲波氣體流量計(jì)中全數(shù)字AGC的設(shè)計(jì)
超聲波流量計(jì)是一種新興的工業(yè)產(chǎn)品,具有無(wú)阻擋體,無(wú)可動(dòng)件,無(wú)壓損,無(wú)示值漂移,適用于大口徑管道測(cè)量,測(cè)量精確度高,重復(fù)性強(qiáng),量程比寬,可承受工作壓力高,...
FPGA視頻教程:SF-EP1C開(kāi)發(fā)板-VGA字符顯示實(shí)驗(yàn)
VGA(視頻圖形陣列)作為一種標(biāo)準(zhǔn)的顯示接口在視頻和計(jì)算機(jī)領(lǐng)域得到了廣泛的應(yīng)用u,在圖像處理中若是采用傳統(tǒng)的數(shù)據(jù)傳輸方式來(lái)使高分辨率圖像實(shí)時(shí)顯示在顯示器...
2019-12-13 標(biāo)簽:fpgavga開(kāi)發(fā)板 1858 0
使用Vivado HLS創(chuàng)建一個(gè)EDK PCore
由于Zedboard是ARM+FGPA的架構(gòu),所以在使用的時(shí)候經(jīng)常會(huì)涉及到關(guān)于FPGA設(shè)計(jì)方面的知識(shí),對(duì)于像我這樣對(duì)FPGA一竅不通的人來(lái)說(shuō),這是一個(gè)不...
2017-02-09 標(biāo)簽:FPGAVivado HLSEDK PCore 1857 0
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