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信號完整性2

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信號完整性基礎-串擾

串擾 :即兩條信號線之間的耦合引起的線上噪聲干擾。
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淺談影響PCB信號完整性的關鍵因素

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如何最大程度地降低地彈噪聲對單板信號完整性影響?

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S參數:信號完整性的風象標

隨著速率的不斷提高,信號能夠在鏈路中傳輸的難度越來越大,信號質量會不斷下降,我們把高速信號在傳輸中遇到各種問題統稱為信號完整性問題。
2023-06-21 14:17:561019

信號完整性基礎知識架構

在模擬電路時期以及模擬向數字信號過渡的初期,由于電路的信號速度并不高,這個時候信號完整性的問題并不突出。
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信號完整性基礎-S參數概述

S參數也叫散射參數,最初是用來描述射頻電路應用中入射波和反射波的關系,隨著數字信號的高速化,S參數在高速數字信號的應用中逐漸普及。
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信號完整性分析是一個很復雜的系統工程,它是各種影響信號質量和時序的問題的疊加組合。且隨著信號速率的提高,信號完整性問題變得越來越復雜,需要考慮的因素越來越多。
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淺析信號完整性中的串擾

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終端端接在信號完整性中的意義

終端端接對于信號完整性有著重要的意義,它和源端匹配一樣都是解決信號完整性問題的重要手段。
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信號完整性分析是基于傳輸線理論的,研究信號完整性必須從認識傳輸線開始,而傳輸線中最基本的概念就是阻抗和反射。
2023-06-14 15:40:583716

信號完整性的傳輸通道介紹

我們可以看到一個完整信號的傳輸通道包含了封裝布線、焊盤、過孔、PCB布線、背板連接器、背板布線等等從驅動芯片到接收芯片的線路中的所有組成部分。
2023-06-14 15:37:401673

介紹信號完整性的另一個要素—芯片

有一定基礎的同學也可以直接略過此部分內容,但我覺得在介紹IBIS模型、介紹SIPI仿真之前,還是有必要先講一下各種電平標準,這樣有助我們更好的完成信號完整性仿真和分析。
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介紹一下基于帶寬的信號完整性分析方法

信號完整性分析的兩個維度--時域和頻域,而帶寬是連接時域和頻域的橋梁。同樣,帶寬也將信號的特性、傳輸通道、測試設備聯系在一起,可見帶寬是信號完整性分析中非常重要的一個概念。
2023-06-14 10:36:10598

如何將頻域和時域建立聯系方便的分析解決信號完整性問題?

時域是真實存在的域,頻域只是一個數學構造,但頻域對我們分析解決信號完整性問題非常重要。那么如何將頻域和時域建立聯系方便的分析解決信號完整性問題?因此引出了時域和頻域之間的紐帶--帶寬。對于信號完整性分析來說,帶寬實在是太重要了,這里再嘮叨嘮叨。
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信號完整性面臨的挑戰

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信號完整性角度談如何選擇示波器

我們經常聽到身邊的硬件工程師們提到關于信號完整性的話題。那么信號完整性具體是指什么呢?
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信號完整性的特征描述

信號完整性研究的是如何使驅動器輸出的信號傳輸到接收器件并被正確接收。
2023-06-12 17:22:481576

什么是信號完整性呢?

信號完整性(Signal Integrity,SI),也就是我們通常所說的信號質量。隨著信號速率的提高,數字信號的傳輸已經不能只考慮邏輯上的實現,而要考慮如何能夠使接收器件接收到正確的信號波形。
2023-06-12 15:48:283967

信號完整性基礎--信號質量(一)

眼圖是一系列數字信號波形積累而形成的圖形,通過眼圖可以獲得碼間串擾和噪聲等。通常眼圖顯示兩個碼元的位寬。通過眼圖可以直觀地判斷傳輸性能的好壞。 信號電平電壓、上升沿等等不可能每一次都一致,因此很多次信號的疊加會導致眼圖信號變粗,出現模糊。
2023-06-10 11:42:32586

信號完整性基礎知識架構

在模擬電路時期以及模擬向數字信號過渡的初期,由于電路的信號速度并不高,這個時候信號完整性的問題并不突出。
2023-06-09 15:22:32702

信號完整性基礎--差分信號(一)

本章我們開始《信號完整性基礎》 系列第五章節差分信號相關知識的講解。隨著信號速率的不斷提高,傳統并行接口的應用挑戰越來越大,基于差分信號的Serdes接口越來越普及,差分信號在其中的重要性不言而喻。
2023-06-09 10:37:382874

PCB信號完整性分析入門

PCB中信號完整性分析的基礎知識可能不是基本的。信號完整性仿真工具非常適合在原理圖和布局設計期間計算不同網絡中信號的行為,但您仍然需要采取一些步驟來解釋結果。
2023-06-09 10:31:57628

信號完整性基礎--差分信號(二)

差分信號是共模信號和差模信號的疊加,理想情況下共模信號是恒定的。
2023-06-09 09:08:131898

如何實現高速連接器信號完整性分析

隨著現代電子產品的快速發展,高速連接器LM393越來越廣泛地應用于各種領域。高速連接器的信號完整性分析是確保高速數據傳輸的關鍵之一。本文將介紹如何通過使用仿真工具和適當的測試方法來實現高速連接器信號完整性分析。
2023-06-04 14:30:00983

如何實現高速連接器信號完整性分析?

3D建模與分析,提取S參數,準確分析其插入損耗、回波損耗、串擾等信號完整性性能,可有效提高連接器的傳輸性能,從而提升整個互連系統的傳輸能力。
2023-05-29 14:10:42460

如何設計出具有優異信號完整性的設備?

數據中心利用發射系統和接收系統之間的通道,可以準確有效地傳遞有價值的信息。如果通道性能不佳,就可能會導致信號完整性問題,并且影響所傳數據的正確解讀。
2023-05-15 09:03:29380

利用時域和頻域巧解信號完整性/電源完整性的問題

編者注:在分析信號完整性和電源完整性問題時經常會提到在時域中分析和在頻域中分析。不管是什么分析,分析都是同一個對象。因為有的問題在時域中難以描述,比如能量損失,因為能量是一個系統概念,很難對應到物理
2023-05-14 10:45:12540

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在差分傳輸中,所有信息都由差分信號來傳送。保證差分信號質量很關鍵。
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2023-05-06 14:43:53288

信號完整性之串擾(二)

和上一篇文章中5根信號線之間的寄生電容值矩陣類似,5根信號線之間也有寄生電感值矩陣。如下圖,對角線紅色數值表示信號路徑和返回路徑上的回路自感。其他是信號間的回路互感的,單位是nH/in。
2023-05-06 12:37:391148

信號完整性之串擾(一)

串擾是指有害信號從一個網絡轉移到相鄰網絡。任何一對網絡之間都存在串擾。通常把噪聲源所在網絡稱為動態網絡或攻擊網絡。把受影響的網絡稱為靜態網絡或者受害網絡。
2023-05-06 11:48:081243

信號完整性基礎知識之S參數

本章我們開始《信號完整性基礎》 系列第四章節S參數相關知識的講解。 S參數能反映在頻域范圍內傳輸信號、反射信號的特性,是我們在做PCB SI仿真時最常用的手段。
2023-05-05 12:26:592293

上海 5月26日-27日《信號完整性--系統化設計方法及案例分析》公開課即將開始!

課程名稱:《信號完整性--系統化設計方法及案例分析》講師:于老師時間地點:上海5月26日-27日主辦單位:賽盛技術課程特色信號完整性是內嵌于PCB設計中的一項必備內容,無論高速板還是低速板或多或少
2023-04-25 14:41:10358

信號完整性之反射(八)

?針對傳輸線上寄生電容和寄生電感帶來的反射噪聲,在現實PCB設計中是無法避免的。例如2個PCB板通過B2B連接器結合時,B2B連接器的寄生電感。下圖是一對B2B連接器,可以將兩塊PCB連接起來。
2023-04-23 12:36:35342

信號完整性之反射(七)

高速信號沿著傳輸線傳播時,如果傳輸線中出現90度的拐角,此處就會有阻抗突變發生,導致信號反射及失真。將90度拐角改為45度拐角,可以降低阻抗突變的影響。而使用線寬固定的弧形拐角,效果會更好。
2023-04-23 12:32:27565

信號完整性之反射(六)

之前的文章講述的都是阻性終端負載的反射。其實在負載(芯片管腳)上也有輸入電容存在,通常都是幾個pf。如下Table 174是某顆LPDDR4的各個輸入ball的輸入電容值。特別是當出現一個源端同時驅動多個負載時,負載端的輸入電容并聯總值會更大,例如SOC驅動多個DDR芯片。
2023-04-23 11:50:36593

信號完整性之哪來的串擾?

我們經常聽說PCB走線間距大于等于3倍線寬時可以抑制70%的信號間干擾,這就是3W原則,信號線之間的干擾被稱為串擾,串擾是怎么形成的呢?
2023-04-18 11:06:22992

信號完整性之反射(五)

有些設計中可能是三個或者更多芯片在同一個信號鏈路上,按照flyby拓撲結構布局。如下圖是一顆SOC和3顆DDR3的PCB布局設計。因為三顆DDR3的ADD是共用一組來自SOC的信號線,因此只有ADD
2023-04-15 16:07:50841

信號完整性之反射(四)

現在的芯片管腳越來越多,管腳間距越來越小。有些走線即使想做阻抗控制,也受限于芯片管腳數和管腳間距,在芯片下方走線不得不變窄。當這些走線從芯片下方走出來后,寬度又會恢復到阻抗要求的值。如下圖所示,黃色部分的走線是在SOC下方(紅框中)走過,線寬比較窄。走出SOC之后(紅框外面),走線變粗。在走線寬度變化點,就是阻抗突變點。
2023-04-15 16:05:45732

信號完整性之反射(三)

TDR稱為時域反射計,可以用來測量本身沒有電壓源的無源互連線特性。下圖是TDR的內部結構。源端輸出一個35ps~150ps的快速上升沿信號信號經過一個50R的校準電阻和一段很短的50R同軸電纜線,到達設備的前面板連接端子。此連接端子連接到DUT(待測無源傳輸線)。高速采樣放大器測試紅色點的電壓值。
2023-04-15 16:03:44602

信號完整性之反射(二)

傳輸線的終端匹配有三種特殊情況:開路、短路、終端阻抗和傳輸線阻抗匹配。
2023-04-15 15:58:52753

信號完整性之反射(一)

信號沿互連線傳播時,如果感受到的瞬態阻抗發生變化,則一部分信號被反射回源端,另一部分信號發生失真并且繼續向負載端傳輸過去。這是單一信號網絡中信號完整性主要的問題。反射和失真會導致信號質量下降,例如振鈴。過強的振鈴會超過邏輯電平的閾值,造成誤觸發。
2023-04-15 15:50:381186

信號完整性之電感的知識(三)

下面是兩平面構成的電流回流路徑。平面A是信號路徑,平面B是返回路徑。平面越寬,電流分布越分散,平面的局部自感越小,導致整個回路的電感就越小。平面越長,局部自感就越大,導致整個回路電感越大。平面間距越小,平面間的互感越大,導致整個回路電感越小。
2023-04-14 15:18:361147

信號完整性之電感的知識(二)

現實設計中,電流是在一個完整的回路中流動,此完整電流回路的總電感稱為回路電感,又稱為回路自感。即當回路中流過1安培電流時,從信號源出發,沿著導線行走時,整個回路中所有電流產生的磁力線總匝數。
2023-04-14 15:18:281183

信號完整性之電感的知識(一)

對于一段直導線,當有1A電流流過此導線時,自上而下,此導線的周圍都存在同心的環形磁力線圈。電流周圍的磁力線匝數用單位韋伯來計量。
2023-04-14 15:18:101684

信號完整性和電源完整性的分析

現有產品設計對信號完整性很重視,但對于電源完整性的重視好像不夠,主要是因為,對于低頻應用,開關電源的設計更多靠的是經驗,或者功能級仿真來輔助即可
2023-04-10 09:16:161018

信號完整性仿真三個重點:信號質量、串擾和時序

信號完整性仿真重點分析有關高速信號的3個主要問題:信號質量、串擾和時序。對于信號質量,目標是獲取具有明確的邊緣,且沒有過度過沖和下沖的信號
2023-04-03 10:40:07887

基于HFSS的高速PCB信號完整性研究

信號頻率升高、上升時間減小所引起PCB互連線上的所有信號質量問題都屬于信號完整性的研究范疇。本論文的主要研究可概括為傳輸線在PCB設計制造過程中所產生的信號完整性問題,具體分為三個方面
2023-03-27 10:40:300

超高速電路設計面臨的挑戰與廣義信號完整性(GSI)內涵和走勢

給大家解讀超高速電路設計面臨的挑戰與廣義信號完整性(GSI)內涵和走勢。
2023-03-27 08:55:331119

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